1) clock rate testing
时钟频率测试
2) clock base frequency test
时钟基频测试
3) clock frequency
时钟频率
1.
This paper introduces A/D Converter ICL7135 Series Collection in Single-chip Microcomputer Voltage Meter,interface circuit and clock frequency of AT89C51 and ICL7135.
介绍了双积分A/D转换器ICL7135与AT89C51进行串行数据采集的原理、接口电路的连接方法及时钟频率选择,并且通过实验数据及图形证明了该方法的可行性。
2.
The relations among the error of frequency measurement, measure time, reference clock frequency and the measured signal frequency, are also deduced.
本文针对计数式瞬时测频精度进行分析,提出了通过级数展开来估计测频误差的方法,其中应用了莱布尼兹定理对交错级数进行了取舍,推导出计数式瞬时测频中测频误差与观测时间、基准时钟频率及被测信号频率之间的关系。
3.
Dynamic voltage scaling (DVS) technique is an effective way to reduce processor energy consumption through changing the processor’s supply voltage and clock frequency at the runtime.
动态电压缩放技术是一种能有效优化处理器能耗的方法,它允许处理器在运行时动态地改变其时钟频率和供电电压。
4) clock test
时钟测试
1.
It can reduce the time used to generate the test vectors by using the clock test.
并使用时钟测试来减少生成测试向量所需的时间。
5) TCK Testing Clock
测试时钟
6) Master Clock Frequency
主时钟频率
补充资料：测试结果可接受性的检查和最终测试结果的确定
测试结果可接受性的检查和最终测试结果的确定
check of the acceptability of test results and determination of the final test result
C凡(3)二3.3d，时，取此3个结果的平均值作为最终侧试结果;否则取它们的中位数作为最终测试结果。。，为重复性标准差(即在重复性条件下所得侧试结果的标准差)。 在口田T 11792一1989中还对重复性和再现性条件下所得侧试结果可接受性的检查方法和最终测试结果的确定做了详细讨论和规定。(马毅林)ceshi 11叩uo kejieshCxjxing d6 iiancha he zuizhong ceshi】i闪旧de que心ing测试结果可接受性的检查和最终测试结果的确定(checkof山eac，ptability of test，ults助ddsterminationofthefi耐testresult)在商品检验中进行一次测试的情形不多见，当得到一个测试结果时，所得结果不可能直接与给定的重复性标准差作可接受性的检查。对测试结果的准确性有任何疑问时都应再进行一次测试。所以，对两个测试结果进行可接受性的检查是一般的情况。 可接受性的检查，实际上是一种统计检验。任何两个测试结果只要能通过可接受性的统计检验即可认为是一致的，均可接受。比如，在重复性条件下，所得结果之差的绝对值(下称绝对差)不超过相应的重复性限r(见重复性和再现性)的值，则认为两个结果是一致的，均可接受;如果两个侧试结果的绝对差超过r，则认为它们是不一致的，必须增加测试。 按国家标准《测试方法的精密度在重复性或再现性条件下所得测试结果可接受性的检查和最终测试结果的确定》(GBIT 1 1792一1989)，在重复性条件下，如果两个测试结果的绝对差不超过r的值，可取两个侧试结果的平均值作为最终测试结果。如果两个结果的绝对差超过r的值，并且测试费用较低，须再做两次测试。当4个结果的极差(即其中的最大值与最小值之差)不超过相应的临界极差c，瓜(4)二3.6a，时，取4个结果的平均值作为最终测试结果。如果两个结果的绝对差超过r的值，并且测试费用较高时，只须再作一次测试。当3个结果的极差不超过相应的临界极差
说明：补充资料仅用于学习参考，请勿用于其它任何用途。
参考词条