1) LBC Line Bus Controller
线路总线控制器
2) multiplex bus controller
多路总线控制器
1.
The multiplex bus controller(BC) plays a ker- nel role among of terminals in modern avionics 1553B multiplex communication system.
在现代航空电子1553B多路总线通信系统中,起核心控制作用的通信终端是多路总线控制器(简称BC)。
3) bus controller
总线控制器
1.
Realization of 1553B bus controller based on FPGA;
基于FPGA的1553B总线控制器的实现
2.
SERCOS bus controller SERCON816 and its application;
SERCON816型SERCOS总线控制器及其应用
3.
After introducing the data bus protocol of 1553B simply,this paper mainly discusses the design thinking and method of bus controller by using software,and PCCARD-D1553 card.
在简单介绍1553B数据总线协议的基础上,主要讨论了利用软件和PCCARD D1553板卡实现总线控制器的设计思想和方法,这种方法在不需要利用硬件实现总线控制器且开发周期要求较短的工程中是非常实用和有效的。
4) controller bus
控制器总线
1.
Described in this article are the microcomputer controlled 3 level control system of the locomotive, the computer network made up of train bus,vehicle bus and controller bus,as well as the key technology to achieve locomotive double heading control.
文章介绍了机车微机系统的三级控制及由列车总线、车厢总线、控制器总线组成的计算机网络，以及实现机车重联控制的技术关键。
6) I2C controller
I2C总线控制器
1.
This paper expounded the method of designing a User-Defined Avalon device through integrating a I2C controller in the NiosⅡ system.
本文通过在NiosII系统内部集成一个I2C总线控制器详细说明了自定制Avalon设备的设计方法,并通过行为仿真和系统测试验证了方法的可行性。
补充资料：总线控制器
总线控制器
bus controller
信号，并用这些信号对存储器和输人输出系统的地址锁存、数据收发、允许写和允许输出等进行控制。控制翰人信号控制箱出状态箱人 ┌───┐ │状态机│ └───┘┌──┐ │状态│ │解码│ └──┘ 命令拾出 图1总线控制器电路结构 使用总线控制器的数据允许1〕EN和数据收发Efl丫R信号控制数据总线收发器;其中，用DEN启动数据收发器，用D】丫豆控制数据收发器的方向。利用对DEN和I〕T/R的定时控制，可以避免总线主控设备、数据总线收发器等的总线争用。 利用允许地址锁存ALE的输出确定对地址锁存的时间。从前一个总线操作完成到下一个总线操作出现在锁存器输出端为止，ALE至少要提供一个系统地址保持时间。利用该保持时间，支持多总线和公用存储系统。另外，系统命令的延迟也受到总线控制器的控制。命令延迟信号允许增加地址或写数据的时间，以便系统总线命令借助延迟完成各种总线操作。 使用总线控制器，是为了解决CPU控制负载过重与外引线数目受限制等问题。它使CPU仅产生状态信号，不直接产生控制存储器或1/0电路的读写信号。在构成系统时，就需要总线控制器译码状态信息，从而产生能直接控制驱动存储器和1/0读写的信号。由于总线控制器需要较高的负载能力，因此，一般采用双极型电路。 典型的总线控制器产品为82 C 288，它采用高速CHM()S技术。其主要功能有:提供局部总线和系统总线命令和控制，单+SV电压，全静态器件，与HM(万技术的82288全兼容。zongxian kongzh.qi总线控制器(bus controller)计算机系统中用以代替中央处理器(CPtl)，提供总线控制和命令信号的一种专用集成电路。一般情况下，CPU输出表征该总线周期要存取的设备的状态信号，通过总线控制器产生该总线周期所需的全部总线控制信号及命令输出信号，并对连在总线上的存储器和输人输出(I/O)设备进行控制。总线控制器也称系晚总伐挂润霖。 总线控制器的内部结构主要由状态解码、控制输人逻辑、状态机、控制输出逻辑和命令输出逻辑等组成，其电路结构如图1所示。控制输出提供允许地址锁存ALE、数据收发1〕1，/R、数据允许DEN等
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参考词条