1) CAN bus controller
CAN总线控制器
1.
Rapid-prototyping of a CAN Bus controller;
CAN总线控制器模型的快速测试
2.
In this paper,the main character of CAN bus is discussed and the basic principle of CAN bus controller SJA1000,the hardware and software design of CAN bus repeater circuit based on SJA1000 are introduced.
简要讨论了CAN总线,在此基础上介绍了CAN总线控制器SJA1000的基本特性,以及基于SJA1000的CAN总线中继器的软硬件设计,给出了中继器接口电路、SJA1000初始化流程图、接收及发送数据流程图。
3.
The microchip controls the CAN BUS controller to transmit the data.
该装置采用热释电红外传感器检测是否有车辆通过,由单片机对传感器信号进行计数;单片机同时控制CAN总线控制器进行数据传输。
2) CAN bus controller SJA1000
CAN总线控制器SJA1000
3) SJA1000 CAN bus controller
SJA1000 CAN总线控制器
5) Controller Area Network(CAN)bus
控制器局域网(CAN)总线
补充资料：总线控制器
总线控制器
bus controller
信号，并用这些信号对存储器和输人输出系统的地址锁存、数据收发、允许写和允许输出等进行控制。控制翰人信号控制箱出状态箱人 ┌───┐ │状态机│ └───┘┌──┐ │状态│ │解码│ └──┘ 命令拾出 图1总线控制器电路结构 使用总线控制器的数据允许1〕EN和数据收发Efl丫R信号控制数据总线收发器;其中，用DEN启动数据收发器，用D】丫豆控制数据收发器的方向。利用对DEN和I〕T/R的定时控制，可以避免总线主控设备、数据总线收发器等的总线争用。 利用允许地址锁存ALE的输出确定对地址锁存的时间。从前一个总线操作完成到下一个总线操作出现在锁存器输出端为止，ALE至少要提供一个系统地址保持时间。利用该保持时间，支持多总线和公用存储系统。另外，系统命令的延迟也受到总线控制器的控制。命令延迟信号允许增加地址或写数据的时间，以便系统总线命令借助延迟完成各种总线操作。 使用总线控制器，是为了解决CPU控制负载过重与外引线数目受限制等问题。它使CPU仅产生状态信号，不直接产生控制存储器或1/0电路的读写信号。在构成系统时，就需要总线控制器译码状态信息，从而产生能直接控制驱动存储器和1/0读写的信号。由于总线控制器需要较高的负载能力，因此，一般采用双极型电路。 典型的总线控制器产品为82 C 288，它采用高速CHM()S技术。其主要功能有:提供局部总线和系统总线命令和控制，单+SV电压，全静态器件，与HM(万技术的82288全兼容。zongxian kongzh.qi总线控制器(bus controller)计算机系统中用以代替中央处理器(CPtl)，提供总线控制和命令信号的一种专用集成电路。一般情况下，CPU输出表征该总线周期要存取的设备的状态信号，通过总线控制器产生该总线周期所需的全部总线控制信号及命令输出信号，并对连在总线上的存储器和输人输出(I/O)设备进行控制。总线控制器也称系晚总伐挂润霖。 总线控制器的内部结构主要由状态解码、控制输人逻辑、状态机、控制输出逻辑和命令输出逻辑等组成，其电路结构如图1所示。控制输出提供允许地址锁存ALE、数据收发1〕1，/R、数据允许DEN等
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参考词条