DAC取样时钟延迟,DAC sample clock delay,音标,读音,翻译,英文例句,英语词典

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1) DAC sample clock delay 点击朗读

DAC取样时钟延迟

2) sampling clock 点击朗读

取样时钟

3) the switch clock delay 点击朗读

开关时钟延迟

The new method is the dual conversion technology between DAC with the switch clock delay. 点击朗读

本文分析了影响DAC采样率提高的因素,介绍了采用高速电子开关的双DAC合成转换技术及其不足,然后,在此基础上提出了一种提高DAC采样率的新方法——开关时钟延迟双DAC合成转换技术。

4) delayed matching to sample 点击朗读

延迟取样匹配

5) time-base mismatch 点击朗读

采样时基延迟

6) clock delayed domino logic 点击朗读

时钟延迟多米诺逻辑

Efficiently using of dynamic compound gates,clock delayed domino logic and FET scaling technique,the modified adder architecture achieved good performance.

基于改进的加法器结构 ,有效地使用动态复合门、时钟延迟多米诺逻辑和场效应管尺寸缩小技术 ,可以取得良好的电路性能。

补充资料：[3-(aminosulfonyl)-4-chloro-N-(2.3-dihydro-2-methyl-1H-indol-1-yl)benzamide]

分子式：C16H16ClN3O3S
分子量：365.5
CAS号：26807-65-8

性质：暂无

制备方法：暂无

用途：用于轻、中度原发性高血压。

说明：补充资料仅用于学习参考，请勿用于其它任何用途。

参考词条

存取延迟时钟延缓时延，延迟(自) 延迟时间延迟时

延迟;延时延迟、延时时钟延时延迟采样采样延迟抽样延迟

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	您的位置：首页 -> 词典 -> DAC取样时钟延迟 1) DAC sample clock delay DAC取样时钟延迟 2) sampling clock 取样时钟 3) the switch clock delay 开关时钟延迟 1. The new method is the dual conversion technology between DAC with the switch clock delay. 本文分析了影响DAC采样率提高的因素,介绍了采用高速电子开关的双DAC合成转换技术及其不足,然后,在此基础上提出了一种提高DAC采样率的新方法——开关时钟延迟双DAC合成转换技术。 4) delayed matching to sample 延迟取样匹配 5) time-base mismatch 采样时基延迟 6) clock delayed domino logic 时钟延迟多米诺逻辑 1. Efficiently using of dynamic compound gates,clock delayed domino logic and FET scaling technique,the modified adder architecture achieved good performance. 基于改进的加法器结构 ,有效地使用动态复合门、时钟延迟多米诺逻辑和场效应管尺寸缩小技术 ,可以取得良好的电路性能。补充资料：[3-(aminosulfonyl)-4-chloro-N-(2.3-dihydro-2-methyl-1H-indol-1-yl)benzamide] 分子式：C16H16ClN3O3S 分子量：365.5 CAS号：26807-65-8 性质：暂无制备方法：暂无用途：用于轻、中度原发性高血压。说明：补充资料仅用于学习参考，请勿用于其它任何用途。参考词条存取延迟时钟延缓时延，延迟(自) 延迟时间延迟时

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