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1)  I2C controller
I2C总线控制器
1.
This paper expounded the method of designing a User-Defined Avalon device through integrating a I2C controller in the NiosⅡ system.
本文通过在NiosII系统内部集成一个I2C总线控制器详细说明了自定制Avalon设备的设计方法,并通过行为仿真和系统测试验证了方法的可行性。
2)  I~2C-bus controller PCF8584
I2C总线控制器PCF8584
1.
When the I~2C-bus controller PCF8584 was used,transfers can be carried out either by query and wait or in interrupt services.
本文以TMS320C32为主,讨论了TMS320系列DSP与I2C总线的几种接口方式,给出了使用I2C总线控制器PCF8584的查询等待式传输和中断式传输两种实现方法,以及使用DSP通用双向I/O口模拟I2C总线时序实现数据传输的方法,比较了几种方法的优劣,最后给出了选择方案的依据。
3)  I2C bus controller
I2C总线控制
1.
This system uses the VHDL language to carry on the IPcore realizat ion to the entire function I2C bus controller in the FPGA interior.
并着重介绍了I2C的配置流程,采用VHDL语言对全功能的I2C总线控制器在FPGA内部进行了硬件IPcore实现,系统工作比较稳定,在显示器上得到的增强图像也比较理想。
4)  I2C circuit bus component
I2C总线器件
1.
Their functions were respectively fulfilled by digital temperature transducer DS18B20,I2C circuit bus component AT24C04A and liquid display AMPIRE128×64.
系统的硬件设计包括温度采集、数据储存和数据显示三个模块,其功能分别由数字温度传感器DS18B20、I2C总线器件AT24C04A和液晶显示器AMPIRE128×64完成。
5)  I 2C bus memory
I2C总线存储器
6)  microprocessor/I2C bus
微处理器/I2C总线
补充资料:总线控制器


总线控制器
bus controller

信号,并用这些信号对存储器和输人输出系统的地址锁存、数据收发、允许写和允许输出等进行控制。控制翰人信号控制箱出状态箱人 ┌───┐ │状态机│ └───┘┌──┐ │状态│ │解码│ └──┘ 命令拾出 图1总线控制器电路结构 使用总线控制器的数据允许1〕EN和数据收发Efl丫R信号控制数据总线收发器;其中,用DEN启动数据收发器,用D】丫豆控制数据收发器的方向。利用对DEN和I〕T/R的定时控制,可以避免总线主控设备、数据总线收发器等的总线争用。 利用允许地址锁存ALE的输出确定对地址锁存的时间。从前一个总线操作完成到下一个总线操作出现在锁存器输出端为止,ALE至少要提供一个系统地址保持时间。利用该保持时间,支持多总线和公用存储系统。另外,系统命令的延迟也受到总线控制器的控制。命令延迟信号允许增加地址或写数据的时间,以便系统总线命令借助延迟完成各种总线操作。 使用总线控制器,是为了解决CPU控制负载过重与外引线数目受限制等问题。它使CPU仅产生状态信号,不直接产生控制存储器或1/0电路的读写信号。在构成系统时,就需要总线控制器译码状态信息,从而产生能直接控制驱动存储器和1/0读写的信号。由于总线控制器需要较高的负载能力,因此,一般采用双极型电路。 典型的总线控制器产品为82 C 288,它采用高速CHM()S技术。其主要功能有:提供局部总线和系统总线命令和控制,单+SV电压,全静态器件,与HM(万技术的82288全兼容。zongxian kongzh.qi总线控制器(bus controller)计算机系统中用以代替中央处理器(CPtl),提供总线控制和命令信号的一种专用集成电路。一般情况下,CPU输出表征该总线周期要存取的设备的状态信号,通过总线控制器产生该总线周期所需的全部总线控制信号及命令输出信号,并对连在总线上的存储器和输人输出(I/O)设备进行控制。总线控制器也称系晚总伐挂润霖。 总线控制器的内部结构主要由状态解码、控制输人逻辑、状态机、控制输出逻辑和命令输出逻辑等组成,其电路结构如图1所示。控制输出提供允许地址锁存ALE、数据收发1〕1,/R、数据允许DEN等
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